劉曉慧，劉克成
(南陽(yáng)理工學(xué)院 信息化建設與管理中心，河南 南陽(yáng)473004)
為了滿(mǎn)足用戶(hù)的不同應用需求，設計了一種帶數?；旌陷敵龅募铀俣扔嬒到y。通過(guò)外圍控制信號來(lái)選擇模擬閉環(huán)輸出或者數字閉環(huán)輸出。系統測試表明加速度計的量程為±3 g，模擬輸出帶寬大于2 kHz，噪聲密度小于-100 dBV/√Hz；數字輸出帶寬大于1 400 Hz，噪聲密度小于2 μg/√Hz。
數?；旌陷敵?；閉環(huán)；加速度計；噪聲密度
中圖分類(lèi)號：TN79
文獻標識碼：A
DOI：10.16157/j.issn.0258-7998.166586
中文引用格式：劉曉慧，劉克成. 一種帶數?；旌陷敵龅募铀俣扔嬒到y設計和驗證[J].電子技術(shù)應用，2017，43(11)：31-33.
英文引用格式：Liu Xiaohui, Liu Kecheng. Design and verification of an accelerometer system with mixed analog and digital output[J].Application of Electronic Technique，2017，43(11)：31-33.
0 引言
高性能微機械系統（MEMS）加速度計被用于各種消費市場(chǎng)和軍事領(lǐng)域，如慣性導航與制導、GPS輔助導航、云臺控制、平臺穩定。近年來(lái)由于微機械加速度計的低噪聲、低功耗、低成本和高靈敏度特性，高精度的電容式加速度計日益普及起來(lái)[1-2]。
雖然微機械加工水平不斷提高，但是依然無(wú)法消除敏感結構加工過(guò)程中產(chǎn)生的誤差。為了盡可能地降低由于微機械加工工藝不穩定帶來(lái)的誤差，希望同一款芯片能夠提供盡可能多的可調節手段，這樣當敏感結構由于加工偏差導致參數偏移時(shí)，可以通過(guò)后續的外部參數調節來(lái)進(jìn)行補償或者校正；同時(shí)為了適應不同的應用場(chǎng)景和客戶(hù)需求，同一款芯片應該具備多功能輸出[3]。對于高精度電容式微機械加速度計而言，可以通過(guò)外圍器件控制實(shí)現系統的模擬輸出與數字輸出選擇，這樣就能滿(mǎn)足不同的客戶(hù)需求。模擬輸出和數字輸出功能具有各自的優(yōu)缺點(diǎn)：通過(guò)比較開(kāi)環(huán)模擬輸出和閉環(huán)模擬輸出可以驗證敏感結構的參數特性，同時(shí)模擬輸出經(jīng)過(guò)簡(jiǎn)單的濾波就可以實(shí)現高精度輸出，不需要大規模的數字濾波器占用芯片面積。能夠提供數字輸出功能的微機械加速度計芯片無(wú)需后級高精度AD對模擬輸出進(jìn)行采樣，自然降低了整體的功耗，也能提高系統精度。同時(shí)數字微機械加速度計芯片對敏感結構的參數誤差相對而言不那么敏感[4-6]。
本文為了實(shí)現帶數?；旌陷敵龅奈C械加速度計芯片，設計了通用的前級電荷放大器、輸出和反饋控制以及時(shí)序控制電路，為模擬輸出通路設計了PID電路、低通濾波器等，為數字輸出通路設計了積分器電路和一位的AD、DA電路。本設計最后經(jīng)過(guò)了流片實(shí)驗結果的驗證。
1 電路設計
本設計方案的框圖如圖1所示，圖中包含模擬敏感結構的差分電容對CS1和CS2及控制開(kāi)關(guān)S1~S4，低噪聲電荷放大器電路A1及控制開(kāi)關(guān)S5~S6，采樣保持電路及控制開(kāi)關(guān)（CC、CH、S7~S8、A2），輸出選擇控制、積分器、1位AD及DA、PID單元、低通濾波器(LPF)、緩沖器A3、反饋控制和開(kāi)關(guān)S9。敏感結構通過(guò)鍵合線(xiàn)和芯片電連接，開(kāi)關(guān)S1~S4在控制時(shí)鐘的作用下實(shí)現信號的調制，低噪聲電荷放大器電路A1和采樣保持電路一起實(shí)現信號的解調，通過(guò)電容CC、開(kāi)關(guān)S7和S8的相關(guān)雙采樣技術(shù)實(shí)現了低頻噪聲的消除。輸出控制電路通過(guò)CMOS開(kāi)關(guān)來(lái)選擇數字通路和模擬通路。數字通路上信號經(jīng)過(guò)兩級積分器電路和1 bit A/D實(shí)現數字輸出，積分器、敏感結構、1 bit D/A反饋構成的環(huán)路具有四階噪聲整形能力。模擬通路上PID（比例-積分-微分）控制器用來(lái)調節環(huán)路增益和相位，調整系統的穩定性，通過(guò)片外電阻、電容的選擇來(lái)針對不同的敏感結構進(jìn)行參數配置，增加系統的適配性和靈活性。PID的輸出經(jīng)過(guò)低通濾波器后輸出高精度模擬信號。跟隨器電路A2、A3實(shí)現信號的隔離和增強驅動(dòng)能力。
圖2是前級電荷放大器和積分器電路的運放原理圖。單級折疊共源共柵運放相對于兩級運放而言功耗較小，同時(shí)70 dB以上的增益也能滿(mǎn)足系統的設計要求。采用開(kāi)關(guān)電容共模反饋結構能進(jìn)一步降低功耗。由于后級積分器電路的噪聲能夠被前級整形，所以采樣電容值無(wú)需太大，因此可以降低運放的負載，降低電流消耗。跟隨器和PID中的運放要求比較大的增益，因此采用兩級折疊共源共柵結構來(lái)提供較大的直流增益，能有效提高系統的線(xiàn)性度，降低失真。同時(shí)第二級輸出的擺幅比較大，能滿(mǎn)足系統較大的輸出動(dòng)態(tài)范圍。本文設計的兩級運放直流增益大于100 dB，帶寬約為4 MHz。
如圖3所示的PID能為系統提供額外的電學(xué)阻尼，尤其是當敏感結構阻尼系數較低時(shí)，就需要PID提供電學(xué)阻尼來(lái)維持電學(xué)系統的穩定性。從理論上來(lái)講，PID給閉環(huán)傳輸函數引入一個(gè)位于-KD/KP的零點(diǎn)來(lái)補償系統的阻尼比，其中KD=-1/R2C2，KP=-R3/R2。
由于積分器的輸出信號擺幅不大，所以積分器電路中的運放也采用單級折疊共源共柵結構，可以有效減少整體的功耗。因為積分器的噪聲可以被前級整形，因此其采樣電容和積分電容可以等比例縮放，只要維持電容比不變即可。對于1位AD來(lái)說(shuō)，簡(jiǎn)單來(lái)講就是采用鎖存比較器來(lái)實(shí)現。本設計的采樣頻率為250 kHz，對于比較器速度的要求不高，需要關(guān)注的是比較器的精度。
2 測試
芯片PAD采用硅鋁絲鍵合和基板進(jìn)行電連接。采用片外晶振在片內進(jìn)行分頻，分別給前級電荷檢測部分和后級積分器提供時(shí)鐘。電源電壓3.3 V，參考電壓±1.65 V，為了降低設計難度，敏感結構采用常壓封裝的三明治結構，理論上的機械噪聲小于1 μg/√Hz。由于采用了非真空封裝，所以數字輸出通路上無(wú)需采用相位補償器進(jìn)行相位補償。為了盡量減少外界環(huán)境干擾對測試結果的影響，對測量系統進(jìn)行減震處理[7]。通過(guò)開(kāi)關(guān)選擇數字通路輸出有效，用邏輯分析儀采集加速度計系統的數字輸出碼流，在MATLAB標準程序中對262 144點(diǎn)數據進(jìn)行處理，其數字輸出頻譜如圖4所示。經(jīng)過(guò)減震處理后的低頻部分較為平坦，證明減震系統具有較好的環(huán)境噪聲濾出效果。如果按照底噪水平提升3 dB作為應用帶寬限制的話(huà)，從圖4中可以大概估算出應用帶寬為1.4 kHz，實(shí)際上從系統的信號傳輸曲線(xiàn)來(lái)講，理論上的應用帶寬遠大于1.4 kHz。
對整體結構做±1 g的翻轉實(shí)驗，測算出系統的靈敏度約為1.65 V/g。將圖4中的頻譜歸一化值轉換為噪聲密度，得到的數字輸出噪聲譜密度如圖5所示。后級電路的量化噪聲、運放噪聲都得到了充分的噪聲整形，低頻處的噪聲密度小于2 μg/√Hz，主要受前級電荷放大器引入的噪聲限制，可能是參考電壓和開(kāi)關(guān)熱噪聲。小于10 Hz的低頻處噪聲高于2 μg/√Hz，這應該是環(huán)境噪聲引入的。雖然本系統采用了減震處理，能夠濾出大部分的環(huán)境噪聲，但更低頻處的環(huán)境噪聲消除還需要對減震系統做進(jìn)一步的優(yōu)化。模擬輸出帶寬大于2 kHz，輸出的噪聲密度頻譜圖如圖6所示，圖中的尖峰為50 Hz工頻干擾以及低頻環(huán)境干擾，輸出噪聲約為-100 dBV。根據敏感結構和電源電壓估算系統的量程約為±3 g。
3 結束語(yǔ)
本文針對不同的應用需求，設計了帶數?；旌陷敵龅奈C械加速度計系統，測試結果表明數字輸出低頻處的噪聲密度小于2 μg/√Hz，帶寬大于1.4 kHz，模擬輸出噪聲小于-100 dBV，帶寬大于2 kHz，經(jīng)過(guò)測試驗證了設計的正確性。
參考文獻
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